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verilog编写的具有奇偶校验uart发送模块

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  • 上传时间:2021-06-30
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  • 标      签: Verilog

资 源 简 介

verilog编写的uart发送模块,起始位,数据位,可选择的奇偶校验位,停止位。仿真可用

文 件 列 表

uart_rx.v

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